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40 nm Device Portfolio
Stratix IV E FPGA Features
Maximum Resource Count for Stratix IV E FPGAs (0.9 V)
EP4SE230
EP4SE360
EP4SE530
EP4SE820
ALMs
LEs (K)
Registers 1
M9K memory blocks
M144K memory blocks
MLAB memory (Kb)
Embedded memory (Kb)
18 x 18 multipliers
91,200
228
182,400
1,235
22
2,850
14,283
1,288
141,440
354
282,880
1,248
48
4,420
18,144
1,040
212,480
531
424,960
1,280
64
6,640
20,736
1,024
325,220
813
650,440
1,610
60
10,163
23,130
960
Global clock networks
16
Regional clock networks
Periphery clock networks
PLLs
64
88
4
88
88
12
88
112
12
88
132
12
Design security
Others
I/O voltage levels
supported (V)
I/O standards supported
3
Programmable Power Technology
1.2, 1.5, 1.8, 2.5, 3.3 2
LVTTL, LVCMOS, PCI, PCI-X, LVDS, mini-LVDS, RSDS, LVPECL, Differential SSTL-15, Differential SSTL-18,
Differential SSTL-2, Differential HSTL-12, Differential HSTL-15, Differential HSTL-18, SSTL-15 (I and II),
SSTL-18 (I and II), SSTL-2 (I and II), 1.2 V HSTL (I and II), 1.5 V HSTL (I and II), 1.8 V HSTL (I and II)
Emulated LVDS channels,
1,100 Mbps
LVDS channels, 1,600 Mbps
(receive/transmit)
128
56/56
256
88/88
256
112/112
288
132/132
Embedded DPA circuitry
OCT
Memory devices supported
3
Series, parallel, and differential
DDR3, DDR2, DDR, QDR II, QDR II+, RLDRAM 2, SDR
1
2
This is the base core logic register count. The ALM can support three registers when used in LUTREG mode, which can increase the total register count by an additional 50 percent.
3.3 V compliant, requires a 3 V power supply.
Altera Product Catalog
?
2013
?
www.altera.com
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